CURATED OPEN HARDWARE

Alle Board-Projekte

Ausgewählte Open-Source-Board-Projekte und technische Materialien von CrowdSupply, Hackaday und Hackster.io – gebündelt an einem Ort

Ausschließlich als Referenz für Entwickler: ZouIC verweist auf diese Projekte und hostet weder Code noch Dateien. Urheberrecht und Lizenz verbleiben bei den jeweiligen Autoren gemäß der jeweiligen Projektlizenz. Open-Source-Lizenzen
ASL Classification with Vitis-AI
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ASL Classification with Vitis-AI

Dieses Projekt ist ein Anfangsleitfaden für die ASL-Klassifizierung, der in unserer Webinarreihe für ZUBoard vorgestellt wurde.

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Fix for Vitis Unified 2023.2 Launching into Blank Screen
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Fix for Vitis Unified 2023.2 Launching into Blank Screen

Dieses Schreiben geht durch, wie man Vitis Unified IDE 2023.2 behebt, wenn es nichts anderes tut als auf einem leeren Bildschirm in Ubuntu startet.

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JetCar, the mini self-driving car project
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JetCar, the mini self-driving car project

Der JetCar ist ein Mini-Selbstfahrer, der auf dem Jetson Nano basiert. Es navigiert auf einer Straßenkarte und befolgt Stopptext und Richtungspfeile.

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Vitis-AI DPU-TRD for 2024.x with VIVADO and Kria/MPSoC
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Vitis-AI DPU-TRD for 2024.x with VIVADO and Kria/MPSoC

Dieser Artikel behandelt allgemeine Schritte und Methoden zur Erstellung des Vitis AI Enablement Projekts mit DPU Design in 2024.x Tool für Kria oder MPSoC.

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GitHub HTML
GitHub IoT

Planck-Pi

Eine extrem kompakte, kostengünstige Linux-Entwicklungsboard basierend auf der Allwinner F1C200s SoC. Die Leiterplatte misst nur 31×22 mm und integriert DDR + eMMC, wobei die meisten GPIOs über einen M.2 Key-A Edge Connector ausgesetzt sind, um sie einfach mit Carrier Boards zu stapeln. GPL-3.0 lizenziert; Kernhardware von GeekWaedons "Quantum Plan".

LinuxF1C200sAllwinnerM.2+2
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Preventing Bird Strike at Airport with KRIA KV260
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Preventing Bird Strike at Airport with KRIA KV260

Mit dem KV260 DPU Core & ML können Vögel in der Nähe des Flughafens erkannt und Vogelschläge während der Annäherung / Landung / Start verhindert werden.

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Pulse counter implemented in FPGA: hardware (VHDL) design
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Pulse counter implemented in FPGA: hardware (VHDL) design

Ein schneller Zähler, der Zeitintervalle zwischen aufeinanderfolgenden Impulsen wie detektierte Photonen in den Life Sciences aufzeichnet

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XDF 2018 Mastering Programmable Logic with Xilinx SDSoC
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XDF 2018 Mastering Programmable Logic with Xilinx SDSoC

Mit bewährten Flows für SDSoC lernen Sie, wie Sie mit SDSoC navigieren. Durch praktische Labors erstellen wir ein Design für eine bereitgestellte Plattform.

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Ultra96_robota
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Ultra96_robota

Verwenden Sie die Kamera und die Vitis-AI-Plattform, um einen Roboterhund zu erstellen, der Menschen und Katzen erkennen kann.

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Running Line detection app on Kria KV260(Xilinx DPU)
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Running Line detection app on Kria KV260(Xilinx DPU)

Die Idee hinter diesem Projekt besteht darin, ein ausgebildetes neuronales Netzwerk zu verwenden und zu versuchen, es zu optimieren, um die beste Hardwareleistung zu erzielen.

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KV260 BIST Tutorial - Recreating with VIVADO/Vitis 2025.1
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KV260 BIST Tutorial - Recreating with VIVADO/Vitis 2025.1

Erstellung der BIST-App auf 2025.1 für Kria Vision Kit.

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UARTLite FPGA to Linux: TTY Driver + Python Access via PCIe
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UARTLite FPGA to Linux: TTY Driver + Python Access via PCIe

Zuordnung von FPGA UARTLite IP auf Linux über PCIe XDMA. TTY-Schnittstelle und direkter Python mmap-Zugriff. Perfekt für SDR und Embedded-Anwendungen!

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Kredite an Autoren und Plattformen

Alle hier zusammengefassten Projekte stammen von den oben aufgeführten Open-Source-Plattformen und das Urheberrecht bleibt bei den ursprünglichen Autoren. Wir respektieren die Arbeit jedes Open-Source-Mitwirkenden und alle Inhalte folgen seiner ursprünglichen Open-Source-Lizenz. Wenn Sie ein Projektautor sind und den entsprechenden Inhalt entfernen möchten, kontaktieren Sie uns bitte.

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