Empowering DUNE: A Guide to Starting with KRIA KR260, Vivado
In diesem Tutorial zeigen wir die Schritte zum Erstellen und Konfigurieren eines ersten PL-PS-Projekts mit KRIA KR260, Vivado 2022.2 und Petalinux 2022.2
Speech controlled robot with Tensil and Arty A7 - Part 2
Erfahren Sie, wie Sie einen sprachgesteuerten Roboter mit Tensil, Digilent Arty A7 FPGA Board und Pololu Romi Chassis bauen.
Edge Impulse on Kria KR260
Dieses Projekt geht durch die Installation von Edge Impulse auf dem Ubuntu 22.04-Bild des Kria KR260 und die Entwicklung eines grundlegenden ML-Modells.
Vitis HLS: Direct Digital Synthesizer implementation
Implementierung von vollständig pipelined DDS IP-Kernen in Vitis HLS mit truncated, dithered Phase und Taylor serieller Ausgangskorrektur
Kria Kitchen ML Lifeguard
Intelligentes Gerät, das unbeaufsichtigte Küchengeräte mit Computer Vision mit Machine Learning überwacht.
VHDL Testing Platform
Einfach zu bedienende Plattform zum Lernen von VHDL. Laufen auf einem ZYBO über das Web.
KRIA™️ KR260 - "The right engine for the right task"
Beginnen Sie mit dem KRIA KR260 Entwicklungskit für Roboteranwendungen. Aufbau der Plattform und Partitionierung des Systems.
Agriculture crop disease detection using ML & Kria KV260
Um Verluste aufgrund von Krankheiten in Pflanzen zu bekämpfen, kann ein maschinelles Lernsystem mit Edge AI, das Krankheiten erkennt, Landwirten helfen, einen höheren Ertrag zu erzielen.
PYNQ-Z2 HDMI Usage - 3: Using Sobel Filter with HDMI
Diesmal fügen wir den HLS Sobel Filter IP zum HDMI Passthrough hinzu, um eine Echtzeit-Bildverarbeitung zu erreichen.
Use Tensil and PYNQ to run ResNet-20 on Ultra96 FPGA board
Zeigen Sie, wie Sie den Open-Source-Beschleuniger von Tensil und Xilinx PYNQ verwenden, um das ResNet-20-Modell auf der Avnet Ultra96-Entwicklungsboard auszuführen.
FIR filters on FPGA
Entwerfen, testen und implementieren verschiedener FIR-Filter auf FPGA mit dem MYIR-Entwicklungsboard
Minized - Vitis Accelerated with PMOD SD-CARD
Minimiert - Vitis Beschleunigte Plattform mit PMOD SD-CARD Adapter
Petalinux Build for ADRV9009 + ZCU102 Custom Design
Schritt-für-Schritt-Anleitung zum Erstellen eines benutzerdefinierten PetaLinux-Bildes für das ADRV9009 + ZCU102 nach der Änderung des HDL-Referenzdesign durch Analog Devices.
One of the coolest FPGA Technologies: AMDs DFX
Hardware-Austausch innerhalb von Mikrosekunden: Möglich, wenn FPGAs von AMD verwendet werden. Diese Technik nennt man Dynamic Function Exchange.
Creating VEK280 10G PL Ethernet based Vitis Custom Platform
Erstellung einer benutzerdefinierten Vitis-Basisplattform basierend auf 10G PL Ethernet mit 2024.1-Tools für AMD Versal VEK280!
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Minized with PMOD-TFT LCD
Minimiert mit PMOD-TFT LCD angeschlossen. Ziel ist es, ein SPI-LCD in Verilog einzurichten, so dass Sie Pixel frei in das Display streamen können!
Karp, Petalinux and Vitis-AI 2.0
Dieses Projekt erläutert, wie Vitis-AI 2.0 in Petalinux für die Kria Autonomous Robotic Platform (Karp) installiert wird.
Empowering DUNE: AXI UARTLite using Petalinux 2022.2 in KRIA
In diesem Tutorial zeigen wir die Schritte zum Erstellen des Hardwaredesigns, um die AXI UARTLite IP zu unterstützen und mit Petalinux 2022.2 zu interagieren.
ASL Classification with Vitis-AI
Dieses Projekt ist ein Anfangsleitfaden für die ASL-Klassifizierung, der in unserer Webinarreihe für ZUBoard vorgestellt wurde.
Fix for Vitis Unified 2023.2 Launching into Blank Screen
Dieses Schreiben geht durch, wie man Vitis Unified IDE 2023.2 behebt, wenn es nichts anderes tut als auf einem leeren Bildschirm in Ubuntu startet.
Vitis-AI DPU-TRD for 2024.x with VIVADO and Kria/MPSoC
Dieser Artikel behandelt allgemeine Schritte und Methoden zur Erstellung des Vitis AI Enablement Projekts mit DPU Design in 2024.x Tool für Kria oder MPSoC.
Preventing Bird Strike at Airport with KRIA KV260
Mit dem KV260 DPU Core & ML können Vögel in der Nähe des Flughafens erkannt und Vogelschläge während der Annäherung / Landung / Start verhindert werden.
Pulse counter implemented in FPGA: hardware (VHDL) design
Ein schneller Zähler, der Zeitintervalle zwischen aufeinanderfolgenden Impulsen wie detektierte Photonen in den Life Sciences aufzeichnet
XDF 2018 Mastering Programmable Logic with Xilinx SDSoC
Mit bewährten Flows für SDSoC lernen Sie, wie Sie mit SDSoC navigieren. Durch praktische Labors erstellen wir ein Design für eine bereitgestellte Plattform.
Ultra96_robota
Verwenden Sie die Kamera und die Vitis-AI-Plattform, um einen Roboterhund zu erstellen, der Menschen und Katzen erkennen kann.
Running Line detection app on Kria KV260(Xilinx DPU)
Die Idee hinter diesem Projekt besteht darin, ein ausgebildetes neuronales Netzwerk zu verwenden und zu versuchen, es zu optimieren, um die beste Hardwareleistung zu erzielen.
KV260 BIST Tutorial - Recreating with VIVADO/Vitis 2025.1
Erstellung der BIST-App auf 2025.1 für Kria Vision Kit.
UARTLite FPGA to Linux: TTY Driver + Python Access via PCIe
Zuordnung von FPGA UARTLite IP auf Linux über PCIe XDMA. TTY-Schnittstelle und direkter Python mmap-Zugriff. Perfekt für SDR und Embedded-Anwendungen!
Light Sensor Controller in HLS
Wie man einen Lichtsensor in HLS mit Basys 3 Board steuert.
How to use Zmod AWG DAC converter with the Eclypse Z7 FPGA
Sehen Sie, wie Sie den Zmod AWG DAC-Konverter mit dem Eclypse Z7 FPGA-Board mit Vivado 2021.2 verwenden.
From Code to Canvas: A SOM-Powered Robotic Writing Arm
Verwenden Sie das AMD Kria™ KR260 Robotics Starter Kit und ROS2, um einen Roboterarm zu betreiben, der autonom Text auf ein Whiteboard schreibt.
Control GPIO from PYNQ and KR260
Dieses Projekt ist Teil eines Teilprojekts des AMD Pervasive AI Developer Contest. Wir führen Tests mit PYNQ und GPIO auf dem KR260 durch.
Matbi Watch on Zybo Z7 using Verilog HDL
Hallo Matbi Watch :) Ziel dieses kurzen Projekts ist die Herstellung von Watch auf FPGA mit Verilog HDL.
360° Object Detection Robot Car
Dies ist der 360° Objekt Detection Roboter Car mit dem KR260. Dieser Roboter wurde für den AMD Pervasive AI Developer Contest entwickelt.
Accelerated Sine Wave Application in Vitis 2021.2
Dieses Projekt zeigt, wie die Erzeugung einer Sinuswelle in die PL des FPGAs in einer beschleunigten Anwendung in Vitis 2021 entladen wird.2
Human Following Robot
KR260 und ROS2 basierte KI Roboter, der jedem Menschen folgen kann.
Updating the HW Design in an Accelerated App in Vitis 2023.2
Dieses Projekt zeigt, wie man die verwendete Hardware-XSA-Datei für eine beschleunigte App in Vitis Unified 2023 aktualisiert.2
Speech controlled robot with Tensil and Arty A7 - Part 1
Erfahren Sie, wie Sie einen sprachgesteuerten Roboter mit Tensil und Digilent Arty A7 FPGA Board bauen
Using eInk Displays with the ZynqberryZero
Sehen Sie, wie Sie ein eInk-Display mit dem UC8151D-Chipset von einem ZynqberryZero steuern, das Circuit Python von Adafruit ausführt.
Empowering DUNE: Support for hard peripherals RPi+PMOD KRIA
In diesem Tutorial zeigen wir die Schritte zum Erstellen des Hardwaredesigns zur Unterstützung der RPi- und PMOD-Stecker in KRIA KR260
Radar based 3D Object Detection for mobile robot
Running Center-basierte Radar und Kamera Fusion für 3D Objekt Erkennung auf KV260
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Accelerated Visual Sense using RealSense Lidar
Erstellung räumlich bewusster KI mit einer RealSense-Kamera und der Ultra96v2.
Using AXI DMA on Genode
Die Datenübertragung an/von der FPGA von Zynq ist ein wesentlicher Bestandteil für die Integration von individuellen Beschleunigern.
Getting Tensil to run ResNet at 300 FPS on ZCU104
In diesem Tutorial zeigen wir, wie Tensil mit ResNet20 optimiert wird, das auf CIFAR ausgebildet ist, um maximale Leistung zu erzielen.
Getting Started with AMD Spartan™ 7 FPGA in Vivado™ 2023.2
Dieses Projekt geht durch, wie man ein Hardwaredesign für den SP701 entweder für OS-freie oder Linux-Anwendungen in Vivado 2023.2 erstellt.
Xilinx KV260 - JTag Fan Toggle using VIO
Dies ist ein grundlegendes Tutorial, wie Sie den VIO verwenden, um den KV260-Lüfter mit JTag ein- und auszuschalten
Zynqberry QSPI Boot Workaround for Vitis 2021.x and Later
Dieses Projekt geht durch, wie man den QSPI-Flash von Trenz Electronics Zynqberry-Boards (TE0726 & TE0727) in Vitis 2021.x und höher programmiert.
VHDL FIR Filter Vivado Simulation and Implementation
Erstellung von MATLAB-Koeffizienten → Vivado Simulation → Implementierung von PYNQ-Z2 mit validierten Ergebnissen
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