RTSP Feed Camera Source for Edge Impulse on Kria KR260
In diesem Projekt verwende ich einen RTSP-Kamera-Feed mit meinem Edge Impulse-Modell, das auf meinem KR260 läuft, um eine drahtlose Einrichtung zu haben.
Using ChipScope to Debug AMD Versal Designs
In diesem Projekt werden wir untersuchen, wie wir interne Logikanalysatoren verwenden können, um eine Versal Edge Image Processing-Anwendung zu validieren.
Does Your FPGA Work? Let It Tell You
Was ist, wenn Ihr FPGA sich selbst testen könnte? Dieses interaktive Projekt überprüft alles von Tasten bis DDR-Speicher, so dass Sie wissen, dass Ihr Board bereit ist
Ultra96-V2 Vitis 2020.2 Test Applications
Erstellen und Ausführen von Testanwendungen aus Vitis-Vorlagen auf Ultra96-V2.
FPGYAY 24 Days of FPGA Advent!!
Twenty Four FPGA-bezogene Links, veröffentlicht einer pro Tag! Vom 1. bis 24. Dezember
Getting Started with BLDCs on Kria KD240 + Motor Kit Part 2
Dieses Projekt geht weiter mit dem Antrieb von BLDC-Motoren auf dem Kria KD240 mit Motor Accessory Kit unter Verwendung von EMF-Daten über einen beschleunigten Kernel.
Electronic dice using FPGA
Elektronischer Würfel oder Zufallszahlengenerator von 1 bis 6 (3 Bits). Die Zufallszahl wird auf der gemeinsamen Anode 7 Segment-Anzeige mit FPGA angezeigt
Arty Z7 - AI accelerator using AXI CDMA
Erfahren Sie, wie Sie einen FPGA-KI-Beschleuniger mit AXI CDMA auf Arty Z7-20 erstellen.
Petalinux vs. Baremetal: Run Your FPGA Video Design!
Unterschied zwischen Petalinux und Baremetal Designs
Stereo Face Detection with the Dual Camera Mezzanine
Diese Anleitung enthält detaillierte Anleitungen zur Implementierung der Gesichtserkennung auf zwei (2) Kameras mit dem Ultra96-V2 und dem Dual-Camera Mezzanine.
Vitis AI ONNX Runtime Engine (VOE) with KR260 + Python
Dieses Projekt ist Teil eines Teilprojekts des AMD Pervasive AI Developer Contest. Wir stellen Vitis AI ONNX Runtime Engine (VOE) mit KR260 vor.
Lemmings Game using Verilog and FPGA
Entwicklung von Lemmings Game mit Verilog und Simulation mit FPGA.
FPGA Implementation of Image K-Means Clustering Algorithm
Das implementierte Bildsegment verwendet den K-Mean-Clustering-Algorithmus für FPGA-Geräte und wurde mit einem Standard-Xilinx AXI4-Stream entwickelt
Air Quality Sensing With Ultra96V2
Logging von CO2 und TVOC in die Cloud mit Ultra96 und PYNQ.
Object Detection(Yolo) with DPU-PYNQ and KR260
Dieses Projekt ist Teil eines Teilprojekts des AMD Pervasive AI Developer Contest. Wir führen Tests mit DPU-PYNQ auf KR260 durch.
Vitis Hardware In the Loop
Wie man Vitis Subsystems auf Hardware in der Schleife mit Vitis ausführt.
Gesture Control of Smart Home Devices with Xilinx KV260
Kompilieren Sie ein vorausgebildetes PyTorch-Modell, das auf einem Xilinx Kria KV260 ausgeführt wird, um Gestenerkennung von einer USB-Webcam aus durchzuführen, um einen FireTV-Stick zu steuern.
Building the Ultra96-V2 PYNQ Base Overlay
Eine Schritt-für-Schritt-Anleitung zum Aufbau des PYNQ-Basis-Overlays für den Ultra96-V2.
PYNQ and Ultra96 Pulse Oximeter
Implementierung eines Pulsoximeters mit PYNQ und dem Click HR4 Sensor.
4 Channel TDC (Time Digital Converter) on Cmod A7 35T
Implementieren Sie einen 4-Kanal-TDC auf Cmod A7 35 mit MicroBlaze und SRAM mit 30ps rms und einer Messrate von 60MSa/s
Edge Impulse on Kria KV260: Basic ML Model Development
Dieses Projekt geht durch die Grundlagen, um Ihr eigenes ML-Modell in Edge Impulse zu erstellen und es auf dem Kria KV260 einzusetzen.
Debugging Accelerated Apps using Emulation in Vitis 2021.2
Dieses Projekt geht durch, wie man ein generisches Projekt in Vitis 2021.2 einrichtet, um FPGA-beschleunigte Anwendungen mit SW & HW-Emulation zu debuggen.
FPGA IP Core Generation with Vitis Model Composer
Dieses Tutorial zeigt, wie Sie FPGA IP-Kerne mit Vitis Model Composer von der Modellierung bis zur Bereitstellung Schritt für Schritt generieren.
LAMP-FPGA: Accelerating Time Series Similarity Prediction
Vorhersage ähnlicher Muster in Zeitreihendaten auf Ultra96-V2 FPGA Board
PhiGent Heimdallr
Dieses Projekt implementierte eine CNN-basierte Stereo-Anwendung auf KV26 SOM-Boards.
Self-driving Car Based on Learning from Vision Demonstration
Ein Modellauto mit KV260 und einer USB-Kamera auf der Vorderseite.
Eclypse Z7 + Digitizer Zmod Software Design in Vitis 2022.1
Dieses Projekt geht weiter mit der Bare Metal Anwendung in Vitis zur Verwendung des Digitizers Zmod auf dem Eclypse Z7 in einem kundenspezifischen Design.
Designing a Custom Carrier Board for AMD Kria™ SOMs Part 2
Dieses Projekt geht durch die Schritte, wie ich mein eigenes benutzerdefiniertes Carrier Board für die AMD Kria™ K24 SOM entworfen habe.
Digital Clock in HLS
Ziel dieses Projekts ist es, die Fähigkeit von HLS bei der Konstruktion eines digitalen Uhrensystems zu demonstrieren.
U96-SVM - Stereo Vision Front-end for Ultra96-V2
Open-lizenzierte Hardware, die Ultra96-V2 Dual MIPI CSI und USB Video Class Schnittstellen zur Realisierung eines Stereo-Vision-Systems bietet.
KRIA KV260-ATROVER (mini)
Die KRIA KV260-ATROVER (AuTonomous ROVER) Miniversion - der erste Prototyp eines autonomen selbstfahrenden Rovers mit PYNQ
Stepper Motor Controller in High-Level Synthesis
Ziel dieses Miniprojekts ist es, einen 4-Phasen-bipolaren Schrittmotor mit High-Level-Synthese für FPGA anzutreiben.
Concept to Prototype U96: Part Three
Der letzte Teil des Projekts zeigt, wie wir eine Bildverarbeitungspipeline in Petalinux erstellen und eine Vitis Acceleration Platform erstellen.
PMOD IP for Kria KV260 using Vivado/VitisHLS/Petalinux2022.1
Dieses Projekt zeigt, wie man den PMOD IO auf dem KV260 Carrier Board unter Petalinux 2023.1 steuert und IP für ihn mit VitisHLS entwickelt.
Floating-Point Numbers on 7-Segment Display in HLS
Dieses Miniprojekt zeigt, wie man eine floating-point-Zahl auf 7-Segmenten mit C/C++ HLS anzeigt.
Designing a Custom Carrier Board for AMD Kria™ SOMs Part 1
Dieses Projekt geht durch die Schritte, wie ich mein eigenes benutzerdefiniertes Carrier Board für die AMD Kria™ K24 SOM entworfen habe.
Mezzanine Board for Ultra96 "96AnalogXperience"
Viele Male brauchen wir vom FPGA einige Signale, um es als Reiz für andere Schaltungen zu verwenden. Diese Platte bringt uns 4 analoge Ausgänge für Ultra96.
Getting Started with the TE0711
Sehen Sie, wie Sie den TE0711 SoM auf der TE0701 Basisplatte von Trenz Electronic laufen lassen.
PYNQ and IOP on Ultra96 Breakout
Implementierung von PYNQ-Overlay mit IOP für den Ultra96 Break Out
UART VHDL Implementation on FPGA with Host Data Exchange
Implementieren eines UART-Kommunikationsprotokolls mit VHDL auf einer FPGA-Entwicklungsboard und Datenaustausch mit Python Serial Terminal
Zynqberry Zero Hardware Design in Vivado 2022.1
Dieses Projekt geht durch das Hardwaredesign für das ZynqberryZero in Vivado 2022.1, um Raspberry Pi-Zubehör mit ihm verwenden zu können.
TE0726 Zynqberry Hardware Design in Vivado 2022.1
Dieses Projekt geht durch, wie man ein grundlegendes Hardwaredesign für das Zynqberry in Vivado 2022.1 erstellt, um mit Raspberry Pi pHATs kompatibel zu sein
LED Patterns on the Arty S7 FPGA board
Verwenden Sie VHDL, um einige coole Muster mit den 4 LEDs auf Digilents Arty S7-25 FPGA Board zu erstellen
Zynq XADC tutorial, Part 2: The HW design
Tutorial zur Verwendung von Xilinx Zynq-7000 XADC. Teil 2 von 3 erläutert, wie man das HW-Design in AMD Xilinx Vivado durchführt.
Getting Started with the Kria KD240 in PetaLinux 2023.2
Dieses Projekt zeigt, wie man ein Linux-Betriebssystem für das Kria KD240 Drives Kit in PetaLinux 2023 erstellt.2
Traffic Segmentation using Xilinx Vitis-AI
Eine Echtzeit-Demo der Verkehrssegmentierung von Shibuya Crossing (Tokio) mit Xilinx Zynq UltraScale+ MPSoC-Entwicklungsboard (Ultra96V2).
PYNQ-Z2 HDMI Usage - 4: Video Processing Seamless Switch
Dieser Beitrag fügt einen Umschalter für den Sobel-Filter hinzu, um sicherzustellen, dass der Bildschirm stabil bleibt ohne Blackout.
BBM: Bridge Baby Monitor for Predictive Maintainence
Ultra96 FPGA-basierte Plattform zur Vorhersage von Strukturausfällen, um Wartungskosten zu senken und Katastrophen zu verhindern.
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